Tech−On!Ranking[MEMS]〜3次元積層のコストが微細化より有利になる設計ルール
日経マイクロデバイス 第267号 2007.9.1
掲載誌 | 日経マイクロデバイス 第267号(2007.9.1) |
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ページ数 | 1ページ (全303字) |
形式 | PDFファイル形式 (299kb) |
雑誌掲載位置 | 103ページ目 |
ある条件下では,Si貫通配線(TSV)による3次元化のコストは,微細化に伴うコストに比べて32nmプロセス以降,有利になる。このような計算結果を『NIKKEI MICRODEVICES』が紹介した。NAND型フラッシュ・メモリーの微細化が進む一方,微細化の高コスト化が大きな問題となっている。微細化に代わる可能性のある手法としてLSI各社が取り組んでいるのが3次元化である。年間100万枚の300m…
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