ＮｅｗｓＬｅｔｔｅｒ ＬＳＩ（ロジック）〜０．０２μｍルールまで 継続的に高速化できる 論理回路を日立が開発
日経マイクロデバイス 第178号 2000.4.1
| 掲載誌 | 日経マイクロデバイス 第178号（2000.4.1） |
|---|---|
| ページ数 | 1ページ （全351字） |
| 形式 | PDFファイル形式 （37kb） |
| 雑誌掲載位置 | 140ページ目 |
高速化微細化回路技術 ０．０２μｍルールまで継続的に高速化できる論理回路「ＴＣＬ（ｔｈｒｅｓｈｏｌｄ ｃａｎｃｅｌｉｎｇ ｌｏｇｉｃ）」を日立製作所が開発した。信号電圧と電源電圧を独立に制御し，高速化に必要な電源電圧を維持したまま，信号電圧を小さくできる。従来のＣＭＯＳ回路では０．１μｍルール以降，ゲート遅延時間を３０ｐｓ以下に短縮できなくなる。これに対してＴＣＬでは０．０２μｍルールでも１５ｐｓ…
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