Ｅ検定準備講座〜Ｖｅｒｉｌｏｇ−ＨＤＬ言語の回路記述を理解する
日経エレクトロニクス 第1167号 2016.5.1
| 掲載誌 | 日経エレクトロニクス 第1167号（2016.5.1） |
|---|---|
| ページ数 | 1ページ （全583字） |
| 形式 | PDFファイル形式 （274kb） |
| 雑誌掲載位置 | 131ページ目 |
今号で紹介する「Ｅ検定 〜電気・電子系技術検定試験〜」（以下、Ｅ検定）のサンプル問題は、Ｅ検定の出題範囲９分野のうち「デジタル」より、デジタル回路図から正しいＶｅｒｉｌｏｇ−ＨＤＬ記述を解く問題である。 近年のＬＳＩやＦＰＧＡのデジタル設計では、Ｖｅｒｉｌｏｇ−ＨＤＬ言語やＶＨＤＬ言語を用いた設計手法が主流だ。Ｖｅｒｉｌｏｇ−ＨＤＬ言語の基本的な回路記述や応用回路記述（ｉｆ文／ｃａｓｅ文／ｆｏｒ…
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