Ｇｕｅｓｔ Ｐａｐｅｒ〜 １０ビット，１２５Ｍサンプル／秒で４０ｍＷの パイプライン型Ａ−Ｄ変換器を開発
日経エレクトロニクス 第906号 2005.8.15
| 掲載誌 | 日経エレクトロニクス 第906号（2005.8.15） |
|---|---|
| ページ数 | 8ページ （全9984字） |
| 形式 | PDFファイル形式 （484kb） |
| 雑誌掲載位置 | 111〜118ページ目 |
吉岡 正人工藤 真大山崎 博後藤 邦彦渡邊 祐富士通研究所システムＬＳＩ開発研究所富士通研究所は，デジタル家電用システムＬＳＩに向けた，パイプライン型Ａ−Ｄ変換器の消費電力を低減できる回路アーキテクチャを開発した。従来のアーキテクチャで一般的なサンプル・ホールド回路を採用しないという考え方である。実際にそのアーキテクチャを導入して，分解能が１０ビットのＡ−Ｄ変換器を試作したところ，従来の同種のＡ−…
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