Ｎｅｗ Ｐｒｏｄｕｃｔｓ〜ＥＤＡツール ＳｙｓｔｅｍＶｅｒｉｌｏｇに対応 アサーションで検証効率化
日経エレクトロニクス 第849号 2003.6.9
| 掲載誌 | 日経エレクトロニクス 第849号（2003.6.9） |
|---|---|
| ページ数 | 1ページ （全2067字） |
| 形式 | PDFファイル形式 （151kb） |
| 雑誌掲載位置 | 51ページ目 |
デジタル回路のＲＴレベル記述言語として業界標準のＶｅｒｉｌｏｇ−ＨＤＬ。このＶｅｒｉｌｏｇ−ＨＤＬで記述するＲＴレベルより抽象度の高い記述，すなわちアーキテクチャ・レベルや動作レベルをサポートする言語として，日本で有望とされるのがＣ言語である。ここにきて，Ｖｅｒｉｌｏｇ−ＨＤＬにシステム・レベル設計／検証向け機能を付加した「ＳｙｓｔｅｍＶｅｒｉｌｏｇ」を推す動きが本格化してきた。 最も積極的なの…
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